課程資料
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I786 FPGA實驗
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開課學期：1091
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開課班級：
電機系 3B
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授課教師：陳信良
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選修
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學期課
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學分數：1.0
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大義 0314 星期四 13:10-15:00
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I786 FPGA LABORATORY
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2020 Fall
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Department of Electrical Engineering 3B
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Professor：CHEN, HSIN-LIANG
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Elective
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Semester
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Credits:
1.0
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Da Yi 0314 Thursday 13:10-15:00
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發展願景
傳揚中華文化，促進跨領域創新，與時精進，邁向國際
It is our objective to promote Chinese culture, enhance cross-disciplinary innovation, seek constant advancement, and embrace global community.
辦學宗旨
秉承質樸堅毅校訓，承東西之道統，集中外之精華，研究高深學術, 培養專業人才，服務社會，致力中華文化之發揚, 促進國家發展.
Based on our motto—“Temperament, Simplicity, Strength, and Tenacity,” “inheriting the merits of the East and the West” and “absorbing the essence of Chinese and foreign cultures,” we make it our mission to pursue advanced research, develop professional talents, serve the society, promote Chinese culture and support national development.
校教育目標
校基本素養
校核心能力
院教育目標
研究創新、科技興國
發展產業、學以致用
培育優秀青年工程師
院核心能力
科學理論與工程知識
系統設計與資通科技
實驗分析與實踐技能
創新整合與終身學習
工程倫理與社會責任
計畫管理與團隊合作
系教育目標
教導數學、物理及電機工程的知識，培養學生成為優秀的電機工程師
培養學生良好的專業倫理與實驗精神，使其養成團隊合作的習慣
培養學生具有國際觀與英語運用的能力
系核心能力
具有運用數學、物理及電機工程知識，解決電機相關的問題的能力
具有使用相關工具，以分析、設計電機工程系統與元件的能力
具有計畫管理、有效溝通與團隊合作，並能理解專業倫理與社會責任的能力
具有英文能力與持續學習的習慣，以因應科技更新與時事變化
課程目標
系教育目標1─教導數學、物理及電機工程的知識，培養學生成為優秀的電機工程師、系教育目標2─培養學生良好的專業倫理與實驗精神，使其養成團隊合作的習慣、系教育目標3─培養學生具有國際觀與英語運用的能力
課程概述
"由於FPGA的應用越來越廣泛，且FPGA已朝向SoC FPGA發
展，因此掌握和熟練應用FPGA對電子產品設計人員愈來愈重要。建立數位積體電路設計能力是本課程主要目標，如：Verilog硬體描述語言及FPGA快速原型機之應用。課程分成兩個階段，首先說明FPGA設計架構、Verilog 語法與Tip、TestBench及功能驗證設計。在階段二的主題中，將涵蓋基礎I/O、SPI、I2C 及Open Core IP移植及硬體debug方式，包含時序分析等。 Real-time Embedded provides targeted, high-quality training designed by experts in FPGA design of hardware. All our training is based on the affordable Xilinx FPGA and can include a number of different areas, for example:
1. Introduction to FPGA design using VerilogHDL.
2. FPGA architecture.
3. RTL simulation using the ISim simulator.
4. Writing Tcl scripts to control the FPGA implementation.
5. FPGA platform device drivers."
授課內容
Verilog硬體描述語言
Vivado軟體使用教學
FPGA晶片開發版介紹
授課方式
投影片
課堂實作
期末報告
成品展示
評量方式
上課用書
（師生應遵守智慧財產權及不得非法影印）
數位積體電路設計-從IC Design的實務面介紹Verilog硬體描述語言, 夏大維, 滄海
參考書目
（師生應遵守智慧財產權及不得非法影印）
黃英叡 編著, Verilog硬體描述語言(二版) (全華圖書)
課程需求
要報告
期末成品成績: 20%
要考試期中考成績: 20%
要分組討論平時實作成績: 20%
其他需求出席成績: 10%
準時上課
輔導時間
- 星期二 13:00-17:00
- 星期五 09:00-11:00
教師聯絡資訊
Email：cxl7@ulive.pccu.edu.tw
分機：33235
課程進度
| 2020/09/17 | 課程介紹、分組指定研讀資料Modelling and comparison of adder designs with Verilog HDL, by D.J. Jackson and S.J. Hannah, IEEE |